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關(guān)于CST端口阻抗的問(wèn)題

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CST求解cpw結(jié)束后，點(diǎn)擊結(jié)果中Wave port,會(huì)看到Wave impedance和line impedance,分別代表什么含義呢？而且我發(fā)現(xiàn)和Designer算出來(lái)的阻抗都差別很大。希望高手指點(diǎn)下。

微波EDA (youglowmentor.com) 網(wǎng)友回復(fù)：

  • 網(wǎng)友回復(fù)

    沒(méi)關(guān)注過(guò)線(xiàn)阻抗，如果是從導(dǎo)帶到下地板的線(xiàn)阻抗的話(huà)，明顯漏掉了兩側(cè)的地啊。
    一般信任wave port阻抗好了

  • 網(wǎng)友回復(fù)

    我也在研究為啥差這么多。可能是Port size的問(wèn)題，也可能是mesh的問(wèn)題。有人能指點(diǎn)一下么。
    至于，wave impedance,你可以根據(jù)z=square(e/u)來(lái)算。
    Line impedance就是我們最常用的transmissionline的概念，一般會(huì)調(diào)整到50。

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